好运快3开奖结果查询|实验截图实验一、第四题 电路图2用与非门 7400

 新闻资讯     |      2019-10-04 14:51
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  第一次搭组合逻辑电路图对组合逻辑电路的实际应用有了一个从臆想到时间的转化 获益颇多 通过此次实验学会了组合逻辑电路的分析从而得知组合逻辑电路的功能。四、实验原理 分析组合逻辑电路思路对函数式进行化简或变换 根据最简式列真值表 判断逻辑功能 由给定的组合逻辑电路写函数式 组合逻辑电路的设计就是按照具体逻辑命题设计出最简单的组合电路。真值表 全加器 Ai Bi Ci SiCi BiCi AiCi BiAi Si Ci 函数式Si Ai Bi Ci Ci全加器 引脚的接法全减器真值表 Ai Bi Ci SiCi 电路图函数式 Si Ai Bi Ci Ci全减器 实验截图 引脚的接法 BiGi AiGi BiAi Gi Di 选做第一题 作出二位加法器的真值表并提出一 个二位加法器的电路设计方案 设计方案 C0 表示进位 A0 B0 表示加数 A1 B1表示被加数 C1 C2表示输出结果 F表示进位 A0 B0 A1 B1 C1 C2 实现电路两个全加器 电子科技大学计算机学院实验中心 实验原理比较“半加器”、“全减器”电路 可以发现它们唯一的区别就是C的一个输入Ai变成了iA。利用74153选择器实现多数表决器要求3个输入中有2个和3个为1时 输出Y为高电平 否则Y为低电平!

  由真值表写函数式 根据最简式列真值表 判断逻辑功能 根据给定事件的因果关系列出真值表全加器全减器相对半加器 半减器而言 考虑了进位 借位的情况 因此 输入端分别有三个 被加数被减数 Bn 加数 减数 和Cn 低一位的进位借位 。用“异或”操作 如果X 开关没有打开时iiA0A 保持半加器的功能 如果X 开关打开时iiA1A 实现半减器的功能。真值表电子科技大学计算机学院实验中心 AiBi Ci SiCi 电路图六、总结分析 本次实验通过验证部分已学逻辑电路学习了解了基本74系列TTL门的各引脚功能熟悉了逻辑门的用法。用7486和7400、7404搭出一位数值比较器电路画出其设计逻辑图 并验证它的运算。通过相关的设计和验证进一步理解了组合逻辑电路门的功能。全加器真值表及输出逻辑表达式参见教材P52。掌握了上述的分析方法和设计方法即可对一般电路进行分析、设计 从而可以正确地使用被分析的电路以及设计出能满足逻辑功能和技术指标要求的电路。实验截图实验一、第四题 电路图2用与非门 7400 和异或门 7486 搭建全加器 全减器电路。真值表Ai Bi Si Ci 函数式Si Ai Bi Ci Ai Bi 真值表Ai Bi Si Ci 函数式Si Ai Bi Ci Bi 实验截图 引脚接法 “全加器”、“全减器”实验可知全加器和全减器逻辑电路的唯一区别就是某个的输入Ai变成了非 因此可以将iA与某个逻辑开关做异或操作 这样如果这个开关打开 其值则变为Ai实现加法器功能 否则保持原来的减法器功能。记录下比较结果。全减器线所示 一位数值比较器的线所示。画出实验电路图 并简述实现原理。电子科技大学计算机学院实验中心 一、实验二组合逻辑电路实验 二、实验目的 学习全加器或全减器的设计方法三、实验内容 7486和7400搭出全加器或全减器电路 画出其电路图 并按照其真值表输入不同的逻辑电平信号 观察输出结果和进位 借位电平 记录下来。连接电路图头脑要清醒 发现有错 要用信号检测来调试。用7400、7404、7432实现上题的多数表决器。根据其真值表化简其逻辑表达式 并将其转化成为异或、与非的形式 按照要求搭建电路。掌握各种门电路的逻辑符号感悟 每个用到的集成门电路都要接电源和接地 不然后产生意想不到的效果。输出接发光二极管 输入接开关。真值表 全加器 Ai Bi Ci SiCi BiCi AiCi BiAi Si Ci 函数式Si Ai Bi Ci Ci全加器 引脚的接法全减器真值表 Ai Bi Ci SiCi 电路图函数式 Si A实验截图实验一、第四题 电路图2用与非门 7400 和异或门 7486 搭建全加器 全减器电路。

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